VHDL-Forum

 
Sie sind nicht eingeloggt.
LoginLogin Kostenlos anmeldenKostenlos anmelden
BeiträgeBeiträge MembersMitglieder SucheSuche HilfeHilfe
VotesUmfragen FilesDateien CalendarKalender BookmarksBookmarks
VHDL-Forum
2 Treffer gefunden
Suchdauer: 0,01 Sekunden
VHDL-Forum Anfang   zurück   weiter   Ende
   Betreff   Autor   Datum 
No new posts Re: Wann macht VHDL Sinn?
Moin [quote:DaMicha] * das Design schafft die geforderte Taktfrequenz (z.B. 20 MHz) [/quote] Ist damit gemeint das, wenn ich z.B. auf einen steigende Flanke beim Clock reagiere das Programm bis zur nächsten steigende Flanke einmal durchgelaufen sein muß? [quote:DaMicha] [quote] Macht VHDL eher bei großen oder auch schon bei kleinen Projekten Sinn? [/quote] Meinst Du jetzt im Vergleich zu Verilog (andere Hardwarebeschreibungssprache) oder meinst Du den prinzipiellen Einsatz von FPGAs, die Zielhardware für VHDL. Man könnte ja auch Microkontroller benutzen. [/quote] Ich meinte damit, wann nutzt man VHDL, wann nimmt man noch Blocksymbole oder was es auch sonst noch für möglichkeiten gibt die Hardware zu beschreiben. mfg happy
diehappy 07.11.06, 08:44
No new posts Wann macht VHDL Sinn?
Moin Ich muß mal vorwegschicken das ich vollkommener Neuling auf dem Gebiet bin. Hättet ihr aber eh gleich gemerkt. :D Wenn ich das Prinzip von VHDL richtig verstanden habe kann man mit dieser Sprache "Bauteile" und die dadrin ablaufenden Prozesse beschreiben. Dabei sieht man aber nicht wie das Programm die angeben letzten endes auf dem Chip realisiert. Wenn das soweit richtig ist, woher weiß man denn wie effektiv das Programm die gewünschten Anforderungen umsetzt? Macht VHDL eher bei großen oder auch schon bei kleinen Projekten Sinn? mfg happy
diehappy 05.11.06, 00:06
 
 
2 von 2 Ergebnisse Anfang   zurück   weiter   Ende
Search

powered by carookee.com - eigenes profi-forum kostenlos

Design © trevorj